'Circuit Design > 🔥HDL' 카테고리의 다른 글
| [Verilog] Verilog를 이용한 AI 설계 응용 및 SoC 설계 (1) (0) | 2024.09.25 |
|---|---|
| [Verilog] 27. Counter (0) | 2024.08.23 |
| [Verilog] 25. AXI - SPI Connection Debugging (3) (0) | 2024.08.23 |
| [Verilog] 24. AXI - SPI Connection Debugging (2) (0) | 2024.07.26 |
| [Verilog] 23. AXI - SPI Connection Debugging (1) (0) | 2024.07.23 |